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Unités associées (1)

Laboratoire des systèmes de centres de calcul

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IC
IINFCOM
DCSL

Publications associées (7)

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A 475 MHz Manycore FPGA Accelerator for RTL Simulation

Sahand Kashani, James Richard Larus

This paper presents the implementation of Manticore: a manycore accelerator for parallel RTL simulation. Manticore packs up to 225 custom soft processors running at 475 MHz on a large FPGA. Implementing manycore accelerators on FPGAs is challenging as desi ...

Association for Computing Machinery, Inc2024

Manticore: Hardware-Accelerated RTL Simulation with Static Bulk-Synchronous Parallelism

Sahand Kashani, James Richard Larus

The demise of Moore's Law and Dennard Scaling has revived interest in specialized computer architectures and accelerators. Verification and testing of this hardware depend heavily upon cycle-accurate simulation of register-transfer-level (RTL) designs. The ...

Assoc Computing Machinery2023

Building Chips Faster: Hardware-Compiler Co-Design for Accelerated RTL Simulation

The demise of Moore's Law and Dennard scaling has resulted in diminishing performance gains for general-purpose processors, and so has prompted a surge in academic and commercial interest for hardware accelerators. Specialized hardware has already redefine ...

EPFL2023